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            更新于 4月27日

            集成電路后端設計工程師

            1.2-1.5萬·14薪
            • 濟南歷下區
            • 3-5年
            • 本科
            • 全職
            • 招5人

            職位描述

            數字后端設計電子/半導體/集成電路
            崗位職責: 該崗位主要負責ASIC中的數字部份的版圖自動布局布線(APR)設計,完成從netlist到GDSII的設計實現。包括Floor Plan、CTS、Place and Routing、Performance/Power/Area優化及后段驗證(DRC、LVS、LPE)。 任職要求: 1.集成電路、微電子、電子信息、自動化相關專業本科畢業。 2.學過數字電路設計、IC后端設計工具 (EDI/ICC/PT/LEC/Voltus/Calibre/…)。 3.樂于團隊合作、善于溝通,且愿意積極學習者。 福利待遇: 1.14薪起,每年調薪1次。 2.餐補、交通補貼、住房補貼(應屆生)、節日補貼。 3.職稱補貼、專利補貼(5K-10K)。 4.10天帶薪假、彈性工作、超舒適辦公環境 。 5.協助申請濟南市住房租賃補貼: 碩士1000元/月、本科700元/月。

            工作地點

            歷下區山東省濟南市高新區漢峪金谷人工智能大廈21層

            職位發布者

            李女士/HR

            立即溝通
            公司Logo聯暻半導體(山東)有限公司
            聯暻半導體(山東)有限公司成立于2014年,注冊資本3000萬元,是全球第三大晶圓制造公司臺灣聯華電子股份有限公司(UMC)在大陸投資設立的集成電路設計服務公司,為客戶提供一站式芯片定制和IP授權服務。公司將技術創新和目標對標國際先進技術,憑借8年在集成電路設計服務領域的深耕和扎實的技術積累,目前已發展成為省內顯著、國內知名的集成電路設計服務企業,公司先后被評為國家專精特新“小巨人”、國家高新技術企業、國家集成電路設計企業、山東省瞪羚企業、山東省“一企業一技術”研發中心、濟南市5150引才企業等。公司自成立至今參與設計芯片成功應用于5G、AI、智能駕駛、高性能計算、工業控制等眾多領域,包含類腦神經網絡芯片、毫米波雷達芯片、高可靠芯片、車規級MCU、加解密芯片、工控電表芯片等眾多芯片。截止2021年底,公司累計取得30項集成電路布圖,實用新型專利10項,申請發明專利2項。集成電路布圖是企業設計技術的核心,在集成電路行業等同于發明專利。公司擁有山東省高性能微納器件與芯片集成省級工程技術研究中心、山東省集成電路研發與測試工程室、山東省“一企業一技術”研發中心、濟南市工程實驗室等省市級研發平臺,是山東省標準化委員會委員單位、山東省電子學會會員單位、山東電子學會半導體器件與集成電路委員會副主任委員單位、濟南市半導體協會副理事長單位、濟南市微電子產業技術創新聯盟副理事長單位,未來公司將將借助資本市場的優勢致力于成為中國ASIC設計企業的標桿。公司自成立以來營收一直處于良好的增長態勢,主導產品市場占有率處省內前列,其中eflash IP設計水平較高,高可靠性芯片全國水平。截止2021年底,公司總資產達1.9億元,2021年度公司營收1.57億元,較去年增長120.17%,納稅總額1295萬元,研發費用占公司銷售收入的比重超過10%。 2021年度公司圍繞集成電路設計的主業,聚焦中國制造2025重點發展高集成度低功耗SoC芯片發展方向,持續提升公司在ASIC芯片設計領域的創新能力和水平,在核心技術領域不斷加強技術創新,將目前行業的“卡脖子”技術與公司發展戰略和客戶的市場需求相結合,開展協同創新。 2022年公司在現有的技術和經驗的基礎上,展開對AI、5G應用、車規級MCU芯片、各類IP等技術的研究及推廣應用,在未來三到五年內,今年公司將以上技術方向的芯片設計和服務作為重要突破口,增加研發投入和推廣應用力度,加強科技攻關,實現發展新跨越。
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